数电课程设计自动打铃

A. 自动打铃器课程设计

我的课程设计也是这个呀，我也没找到呢，郁闷呀
看到了你给我的留言，非常感谢。不过很遗憾没有大图，我现在还在寻找中

B. 自动打铃器

设计的总体思路是：首先利用一个分频模块，即732进制计数器得到1HZ的时钟脉冲，然后接入到一个含60*60*24三个计数器的记时模块中，再将时分秒信息传入译码器中，显示当前时间，同时将时分秒信息连接到时间比较模块，于已设定好的6个响铃时间比较，相等时输出高电平，最后将此比较的输出接入延时电路，使高电平持续5s，从而控制蜂鸣器响铃5s，从而实现了设计要求的各项功能。根据课程设计要求将设计分为6个模块：1、分频模块，用于得到频率为1HZ的时钟脉冲；
2、计时模块，进行时间的计时，同时将当前时间输出给选时模块；
3、显示模块，进行时间的显示。
4、比较模块，比较从计时器得到的当前时间和规定的响铃时间是否相等；相等时，输出高电平，设置的六个响铃时间分别定为：1、00：02：002、00：03：003、00：04：004、00：05：005、00：06：006、00：07：00
5、延时模块，延时比较所得信号中得高电平为5秒钟
。6、防抖动模块，消除竞争冒险引起的在0秒时的瞬时高电平。

模块功能介绍：

1分频模块本模块使用三个74LS160，采用整体置数的方式接成732进制计数器，从实验板上接732HZ时钟信号输入，经过分频得到1HZ时钟信号输出给计时模块，完成从高频率时钟信号向低频率时钟信号的转变。

2计时模块本模块由两个60进制计数器和一个24进制计数器构成，从而实现秒分时之间的转换。60进制计数器及24进制计数器均采用两个74LS160，采用整体置数方式接成。从60进制计数器和24进制计数器这三个输出端分别引出八个端口（秒、分、时的个位及十位分别由四个二进制代码表示），将当前时间编码传送给显示模块，实现时间的显示。

3显示模块本模块由四个八选一数据选择器74LS151和地址选择器74LS161构成。地址选择器74LS161接入一个732 HZ的时钟信号，使能端和清零端接高电平，使其循环工作，产生一组循环地址码A、B、C，接到数码管的地址端，使其循环显示数字。同时，地址选择器74LS161产生的一组循环地址码接入到四个八选一数据选择器74LS151上，使其对地址相同的一组数据进行选择，产生四个二进制数A0,A1,A2,A3，即为数码管所要显示的数字的编码。第一个74LS151上的输入端为秒、分、时个位和十位的四位二进制表示的最低位，通过ABC三端选择某一个输出；，第二个74LS151上的输入端为各时间位的二进制表示的次低位，选择与第一个74151相同的时间为的次低位输出；同理，通过这四个八位二进制数比较器74LS151选出同一组数(如：秒的个位：S0A,S0B,S0C,S0D)做为输出A0,A1,A2,A3，接到显示模块输入端。然后，采用BCD—七段显示译码器7448对实验板上数码管进行驱动。将选择出的时间位A0,A1,A2,A3接至输入端A,B,C,D，使输出端产生七位译码连接到实验箱公共数据输入端ABCDEDG，从而进行数据的显示

4比较模块本模块由一个74LS160构成的一个六进制地址选择器以及六个由compare子模块组成。74LS160构成的六进制地址选择器连接一个732HZ的时钟信号作为输入时钟信号，从而循环产生六个地址码输出给compare子模块，各子模块分别实现秒分时六位中某一位的比较，当六个比较均位相等时，输出高电平，控制响铃。一个compare子模块由四个八选一数据选择器74LS151和一个7485四位数字比较器组成。四个八选一数据选择器74LS151工作原理同显示模块，不同的是四个74LS151六个接口的输入值已固定，即为六组已定的响铃时间秒分时六位中其中一位4位二进制数中的一位。选时模块产生的地址A,B,C接到四个74LS151的地址端，使其选择六组中的同一组数据B0,B1,B2,B3。同时通过输出端将选择后的数据B0,B1,B2,B3输出到一个7485四位数字比较器上，7485其他四个端口输入由选时模块选择的数据A0,A1,A2,A3，将这四组数据进行比较，如相同，则7485输出高电平。这六个compare子模块通过一个与门连接，只有当定时模块中六个compare子模块输出均为高电平时，即当前时间与已定响铃时间相同时才能输出高电平给延时模块，从而控制蜂鸣器的响铃。

5延时模块本模块通过一个74LS161构成的十进制计数器和一个JK触发器实现。74LS161的输入端通过一个366进制的计数器，接入一个732HZ的时钟信号，从而得到2HZ的时钟信号。当input中有上升沿时，JK触发器的J、K端分别置1和0，此时其输出端为高电平，计数器工作，当计数器产生进位时，表示已延时5秒，进位端加非门变为0，由于计数器进位端接非门接回到JK触发器和计数器的清零端，Q端恢复为0，计数器也置零，计数器进位端恢复位0，JK触发器和计数器的清零端无效，等待下一个上升沿的到来。计数时间为：0.5s*10=5s，达到延时目的。

6防抖动模块由于选择比较的时间时，三个地址端产生的竞争冒险导致在0秒时有一个小脉冲，使得蜂鸣器多响一次。为防止此现象的产生，加入以下防抖动电路。在0秒时Q端置零，通过与门消除抖动脉冲的干扰。

C. 急求：数字电子钟设计报告

我们刚刚做完的课程设计..给你啦~~

数字钟设计报告

设计者： 20062073
20062046

目录
1 设计目的 3
2 设计要求指标 3
2.1 基本功能 3
2.2 扩展功能 4
3．方案论证与比较 4
4 总体框图设计 4
5 电路原理分析 4
5.1数字钟的构成 4
5.1.1 分频器电路 5
5.1.2 时间计数器电路 5
5.1.3分频器电路 6
5.1.4振荡器电路 6
5.1.5数字时钟的计数显示电路 6
5.2 校时电路 7
5.3 整点报时电路 8
6系统仿真与调试 8
7.结论 8
参考文献 9
实验作品附图 10

数字钟

摘要：
数字钟是一种用数字电路技术实现时、分、秒计时的装置，与机械式时钟相比具有更高的准确性和直观性，且无机械装置，具有更更长的使用寿命，因此得到了广泛的使用。
数字钟从原理上讲是一种典型的数字电路，其中包括了组合逻辑电路和时序电路。目前，数字钟的功能越来越强，并且有多种专门的大规模集成电路可供选择。
从有利于学习的角度考虑，这里主要介绍以中小规模集成电路设计数字钟的方法。
经过了数字电路设计这门课程的系统学习，特别经过了关于组合逻辑电路与时序逻辑电路部分的学习，我们已经具备了设计小规模集成电路的能力，借由本次设计的机会，充分将所学的知识运用到实际中去。
本次课程设计要求设计一个数字钟，基本要求为数字钟的时间周期为24小时，数字钟显示时、分、秒，数字钟的时间基准一秒对应现实生活中的时钟的一秒。供扩展的方面涉及到定时自动报警、按时自动打铃、定时广播、定时启闭路灯等。因此，研究数字钟及扩大其应用，有着非常现实的意义。
1 设计目的
1．掌握数字钟的设计、组装与调试方法。
2．熟悉集成元器件的选择和集成电路芯片的逻辑功能及使用方法。
3．掌握面包板结构及其接线方法
4．熟悉仿真软件的使用。
2 设计要求及指标
2．1基本功能
1）时钟显示功能，能够正确显示“时”、“分”、“秒”。
2）具有快速校准时、分、秒的功能。
3）用555定时器与RC组成的多谐振荡器产生一个标准频率（1Hz）的方波脉冲信号。
2．2扩展功能
1）用晶体振荡器产生一个标准频率（1Hz）的脉冲信号。
2）具有整点报时的功能。
3）具有闹钟的功能。
4）……

3、方案论证与比较
本设计方案使用555多谐振荡器来产生1HZ的信号。通过改变相应的电阻电容值可使频率微调，不必使用分频器来对高频信号进行分频使电路繁复。虽然此振荡器没有石英晶体稳定度和精确性高，由于设计方便，操作简单，成为了设计时的首选，但是由于与实验中使用的555芯片产生的脉冲相比较，利用晶振产生的脉冲信号更加的稳定，同过电压表的测量能很好的观察到这一点，同时在显示上能够更加接进预定的值，受外界环境的干扰较少，一定程度上优于使用555芯片产生信号方式。我们组依然同时设计了555和晶振两个信号产生电路。（本实验报告中着重按照原方案设计的555电路进行说明）
4、 系统设计框图
数字式计时器一般由振荡器、分频器、计数器、译码器、显示器等几部分组成。在本设计中555振荡器及其相应外部电路组成标准秒信号发生器，由不同进制的计数器、译码器和显示器组成计时系统。秒信号送入计数器进行计数，把累计的结果以‘时’、‘分’、‘秒’的数字显示出来。‘时’显示由二十四进制计数器、译码器、显示器构成，‘分’、‘秒’显示分别由六十进制计数器、译码器、显示器构成。其原理框图如图1.1所示。

5、电路原理分析

5.1数字钟的构成
数字钟实际上是一个对标准频率(1HZ)进行计数的计数电路.由于计数的起始时间不可能与标准时间一致,故需要在电路上加一个校时电路,同时标准的1HZ时间信号必须做到准确稳定.在此使用555振荡器组成1Hz的信号。

数字钟原理框图（1.1）

5．1.1振荡器电路
555定时器组成的振荡器电路给数字钟提供一个频率为1Hz的方波信号。其中OUT为输出。

5.1.2时间计数器电路
时间计数电路由秒个位和秒十位计数器,分个位和分十位计数器及时个位和时十位计数器电路构成,其中秒个位和秒十位计数器、分个位和分十位计数器为60进制计数器,而根据设计要求,时个位和时十位计数器为24进制计数器.

5.1.3分频器电路
通常，数字钟的晶体振荡器输出频率较高，为了得到1Hz的秒信号输入，需要对振荡器的输出信号进行分频。
通常实现分频器的电路是计数器电路，一般采用多级2进制计数器来实现。例如，将32768Hz的振荡信号分频为1HZ的分频倍数为32768（ ），即实现该分频功能的计数器相当于15级2进制计数器。

5.1.4振荡器电路
利用555定时器组成的多谐振荡器接通电源后，电容C1被充电，当电压上升到一定数值时里面集成的三极管导通，然后通过电阻和三极管放电，不断的充放电从而产生一定周期的脉冲，通过改变电路上器件的值可以微调脉冲周期。

5.1.5数字时钟的计数显示控制
在设计中，我们使用的是74**160十进制计数器，来实现计数的功能，实验中主要用到了160的置数清零功能（特点：消耗一个时钟脉冲），清零功能（特点：不耗时钟脉冲），在上级160控制下级160时候通过组合电路（主要利用与非门）实现，在连接电路的时候要注意并且强调使能端的连接，其将影响到整一个电路的是否工作。

电路的控制原理如下：
秒钟由个位向十位进位：0000—0001—0010—0011—0100—0101—0110—0111—1000—1001实现个位的计数，采用的是置数的方式（利用RCO端口），当电路计数到1001的时候采用一个二输入与非门接上级输入的高位和低位输出作为下级的信号，实现了秒区的个位和十位的显示与控制。设计中注意到接的是一个与非门而不是与门，目标在产生一个时钟脉冲。实现正确的显示。
由秒区向分区的显示控制：
基本原理同上，在秒区十位向时区个位显示的时：0000—0001—0010—0011—0100—0101产生了六个脉冲的时候向下级输出一个时钟脉冲，利用的还是与非门，目标仍是实现正确的计时显示。
分区的显示及整体电路反馈清零：
当数值显示达到：23：59的时候要实现清零的工作，采用CLR清零的方式反馈清零。具体设计接出控制端的9，5，3，2用十六进制表示后高电平对应引脚接与非，将非门输出信号的值反馈给各个160芯片的清零端（CLR）既可以实现清零了。

5.2 校时功能的实现
当重新接通电源或走时出现误差时都需要对时间进行校正.通常,校正时间的方法是:首先截断正常的计数通路,然后再进行人工出触发计数或将频率较高的方波信号加到需要校正的计数单元的输入端,校正好后,再转入正常计时状态即可.
根据要求,数字钟应具有分校正功能,因此,应截断分个位的直接计数通路,并采用正常计时信号与校正信号可以随时切换的电路接入其中.
在实验实现过程中使用的是通过开关（普通开关）来实现高低电平的切换，手动赋予需要的高低电平来实现脉冲的供给，将脉冲提供到所需要的输入（CLK）端口，实现校时，仿真过程中能够正常校时并且在校时的时候达到了预定的效果；而在我们进入实际电路连接的时候，利用开关（手控导线点触实现）来实现校时再不像仿真那样的精确了，原因分析是由于使用的是普通的开关同时利用的是手动的对CLK端口赋予脉冲信号，在实现手动生成脉冲信号的过程中产生了扰动，即相当于产生了多个的脉冲信号对需要的数码管进行校时，如此，并没有达到仿真的精确效果，但是在实验中通过改进电路的校时方式，不是用手触开关产生脉冲信号（如若需用手触则需要使用一个锁存器实现去抖动，才能够在脉冲生成时候不产生干扰的脉冲，实现正常的校时），而是使用信号发生器实现信号的提供，对需要校时的数码管在相对应的CLK端口提供脉冲信号实现校时，利用此方式实现校时则比手触开关方式效果要好。

5.3 报时的实现
报时功能的实现原理较为简单，即对所需要报时的输出量进行控制，并对控制产生的信号作为LED显示的信号源，电路连接中要注意到的是在实现LED显示的时候最好连接上一个保护电阻对LED灯器到保护的作用。例如我们的校时时间是 23：59，0010—0011—0101—1001；利用相应的门电路实现满足端口输出是上述条件的时候进行报时即可。

6、系统仿真与调试

7、结论
学贵以致用，通过几天的数字钟设计过程，将从书本上学到的知识应用于实践，学会了初步的电子电路仿真设计,虽然过程中遇到了一些困难，但是在解决这些问题的过程无疑也是对自己自身专业素质的一种提高。当最终调试成功的时候也是对自己的一种肯定。在当前金融危机大的社会背景下，能够增加自身砝码的不仅仅是一纸文凭证书，更为重要的是毕业生是否能够适应社会大潮流的需要，契合企业的要求即又较硬的动手操作及设计能力。此次的设计作业不仅增强了自己在专业设计方面的信心，鼓舞了自己，更是一次兴趣的培养，为自己以后的学习方向的明确了重点。
另外在这次实验中我们遇到了不少的问题针对不同的问题我们采取不同的解决方法，最终一一解决设计中遇到的问题。还有在实验设计中我们曾遇到多块芯片以及数码管损坏的情况造成了数字钟的显示没有达到预期的效果，或是根本不显示，通过错误排除最终确认是元件问题，并向老师咨询跟换元件最终的到解决。在我们曾经遇到不懂的问题时，利用网上的资源，搜索查找得到需要的信息。

参考文献：
李庆武 《电子技术基础实验 数字电子技术及其EDA》 机械工业出版社 2006年7月P32及P78
康华光 《电子技术基础 数字部分》（第五版） 高等教育出版社 2007年11月 P421
范爱平.Multisim 2001在电力电子仿真技术中的应用[J].实验室研究与探索
CSDN软件网下载文件

D. 数字电路设计实验报告（5选1即可）

目录
1 设计目的 3
2 设计要求指标 3
2.1 基本功能 3
2.2 扩展功能 4
3．方案论证与比较 4
4 总体框图设计 4
5 电路原理分析 4
5.1数字钟的构成 4
5.1.1 分频器电路 5
5.1.2 时间计数器电路 5
5.1.3分频器电路 6
5.1.4振荡器电路 6
5.1.5数字时钟的计数显示电路 6
5.2 校时电路 7
5.3 整点报时电路 8
6系统仿真与调试 8
7.结论 8
参考文献 9
实验作品附图 10

数字钟

摘要：
数字钟是一种用数字电路技术实现时、分、秒计时的装置，与机械式时钟相比具有更高的准确性和直观性，且无机械装置，具有更更长的使用寿命，因此得到了广泛的使用。
数字钟从原理上讲是一种典型的数字电路，其中包括了组合逻辑电路和时序电路。目前，数字钟的功能越来越强，并且有多种专门的大规模集成电路可供选择。
从有利于学习的角度考虑，这里主要介绍以中小规模集成电路设计数字钟的方法。
经过了数字电路设计这门课程的系统学习，特别经过了关于组合逻辑电路与时序逻辑电路部分的学习，我们已经具备了设计小规模集成电路的能力，借由本次设计的机会，充分将所学的知识运用到实际中去。
本次课程设计要求设计一个数字钟，基本要求为数字钟的时间周期为24小时，数字钟显示时、分、秒，数字钟的时间基准一秒对应现实生活中的时钟的一秒。供扩展的方面涉及到定时自动报警、按时自动打铃、定时广播、定时启闭路灯等。因此，研究数字钟及扩大其应用，有着非常现实的意义。
1 设计目的
1．掌握数字钟的设计、组装与调试方法。
2．熟悉集成元器件的选择和集成电路芯片的逻辑功能及使用方法。
3．掌握面包板结构及其接线方法
4．熟悉仿真软件的使用。
2 设计要求及指标
2．1基本功能
1）时钟显示功能，能够正确显示“时”、“分”、“秒”。
2）具有快速校准时、分、秒的功能。
3）用555定时器与RC组成的多谐振荡器产生一个标准频率（1Hz）的方波脉冲信号。
2．2扩展功能
1）用晶体振荡器产生一个标准频率（1Hz）的脉冲信号。
2）具有整点报时的功能。
3）具有闹钟的功能。
4）……

3、方案论证与比较
本设计方案使用555多谐振荡器来产生1HZ的信号。通过改变相应的电阻电容值可使频率微调，不必使用分频器来对高频信号进行分频使电路繁复。虽然此振荡器没有石英晶体稳定度和精确性高，由于设计方便，操作简单，成为了设计时的首选，但是由于与实验中使用的555芯片产生的脉冲相比较，利用晶振产生的脉冲信号更加的稳定，同过电压表的测量能很好的观察到这一点，同时在显示上能够更加接进预定的值，受外界环境的干扰较少，一定程度上优于使用555芯片产生信号方式。我们组依然同时设计了555和晶振两个信号产生电路。（本实验报告中着重按照原方案设计的555电路进行说明）
4、 系统设计框图
数字式计时器一般由振荡器、分频器、计数器、译码器、显示器等几部分组成。在本设计中555振荡器及其相应外部电路组成标准秒信号发生器，由不同进制的计数器、译码器和显示器组成计时系统。秒信号送入计数器进行计数，把累计的结果以‘时’、‘分’、‘秒’的数字显示出来。‘时’显示由二十四进制计数器、译码器、显示器构成，‘分’、‘秒’显示分别由六十进制计数器、译码器、显示器构成。其原理框图如图1.1所示。

5、电路原理分析

5.1数字钟的构成
数字钟实际上是一个对标准频率(1HZ)进行计数的计数电路.由于计数的起始时间不可能与标准时间一致,故需要在电路上加一个校时电路,同时标准的1HZ时间信号必须做到准确稳定.在此使用555振荡器组成1Hz的信号。

数字钟原理框图（1.1）

5．1.1振荡器电路
555定时器组成的振荡器电路给数字钟提供一个频率为1Hz的方波信号。其中OUT为输出。

5.1.2时间计数器电路
时间计数电路由秒个位和秒十位计数器,分个位和分十位计数器及时个位和时十位计数器电路构成,其中秒个位和秒十位计数器、分个位和分十位计数器为60进制计数器,而根据设计要求,时个位和时十位计数器为24进制计数器.

5.1.3分频器电路
通常，数字钟的晶体振荡器输出频率较高，为了得到1Hz的秒信号输入，需要对振荡器的输出信号进行分频。
通常实现分频器的电路是计数器电路，一般采用多级2进制计数器来实现。例如，将32768Hz的振荡信号分频为1HZ的分频倍数为32768（ ），即实现该分频功能的计数器相当于15级2进制计数器。

5.1.4振荡器电路
利用555定时器组成的多谐振荡器接通电源后，电容C1被充电，当电压上升到一定数值时里面集成的三极管导通，然后通过电阻和三极管放电，不断的充放电从而产生一定周期的脉冲，通过改变电路上器件的值可以微调脉冲周期。

5.1.5数字时钟的计数显示控制
在设计中，我们使用的是74**160十进制计数器，来实现计数的功能，实验中主要用到了160的置数清零功能（特点：消耗一个时钟脉冲），清零功能（特点：不耗时钟脉冲），在上级160控制下级160时候通过组合电路（主要利用与非门）实现，在连接电路的时候要注意并且强调使能端的连接，其将影响到整一个电路的是否工作。

电路的控制原理如下：
秒钟由个位向十位进位：0000—0001—0010—0011—0100—0101—0110—0111—1000—1001实现个位的计数，采用的是置数的方式（利用RCO端口），当电路计数到1001的时候采用一个二输入与非门接上级输入的高位和低位输出作为下级的信号，实现了秒区的个位和十位的显示与控制。设计中注意到接的是一个与非门而不是与门，目标在产生一个时钟脉冲。实现正确的显示。
由秒区向分区的显示控制：
基本原理同上，在秒区十位向时区个位显示的时：0000—0001—0010—0011—0100—0101产生了六个脉冲的时候向下级输出一个时钟脉冲，利用的还是与非门，目标仍是实现正确的计时显示。
分区的显示及整体电路反馈清零：
当数值显示达到：23：59的时候要实现清零的工作，采用CLR清零的方式反馈清零。具体设计接出控制端的9，5，3，2用十六进制表示后高电平对应引脚接与非，将非门输出信号的值反馈给各个160芯片的清零端（CLR）既可以实现清零了。

5.2 校时功能的实现
当重新接通电源或走时出现误差时都需要对时间进行校正.通常,校正时间的方法是:首先截断正常的计数通路,然后再进行人工出触发计数或将频率较高的方波信号加到需要校正的计数单元的输入端,校正好后,再转入正常计时状态即可.
根据要求,数字钟应具有分校正功能,因此,应截断分个位的直接计数通路,并采用正常计时信号与校正信号可以随时切换的电路接入其中.
在实验实现过程中使用的是通过开关（普通开关）来实现高低电平的切换，手动赋予需要的高低电平来实现脉冲的供给，将脉冲提供到所需要的输入（CLK）端口，实现校时，仿真过程中能够正常校时并且在校时的时候达到了预定的效果；而在我们进入实际电路连接的时候，利用开关（手控导线点触实现）来实现校时再不像仿真那样的精确了，原因分析是由于使用的是普通的开关同时利用的是手动的对CLK端口赋予脉冲信号，在实现手动生成脉冲信号的过程中产生了扰动，即相当于产生了多个的脉冲信号对需要的数码管进行校时，如此，并没有达到仿真的精确效果，但是在实验中通过改进电路的校时方式，不是用手触开关产生脉冲信号（如若需用手触则需要使用一个锁存器实现去抖动，才能够在脉冲生成时候不产生干扰的脉冲，实现正常的校时），而是使用信号发生器实现信号的提供，对需要校时的数码管在相对应的CLK端口提供脉冲信号实现校时，利用此方式实现校时则比手触开关方式效果要好。

5.3 报时的实现
报时功能的实现原理较为简单，即对所需要报时的输出量进行控制，并对控制产生的信号作为LED显示的信号源，电路连接中要注意到的是在实现LED显示的时候最好连接上一个保护电阻对LED灯器到保护的作用。例如我们的校时时间是 23：59，0010—0011—0101—1001；利用相应的门电路实现满足端口输出是上述条件的时候进行报时即可。

6、系统仿真与调试

7、结论
学贵以致用，通过几天的数字钟设计过程，将从书本上学到的知识应用于实践，学会了初步的电子电路仿真设计,虽然过程中遇到了一些困难，但是在解决这些问题的过程无疑也是对自己自身专业素质的一种提高。当最终调试成功的时候也是对自己的一种肯定。在当前金融危机大的社会背景下，能够增加自身砝码的不仅仅是一纸文凭证书，更为重要的是毕业生是否能够适应社会大潮流的需要，契合企业的要求即又较硬的动手操作及设计能力。此次的设计作业不仅增强了自己在专业设计方面的信心，鼓舞了自己，更是一次兴趣的培养，为自己以后的学习方向的明确了重点。
另外在这次实验中我们遇到了不少的问题针对不同的问题我们采取不同的解决方法，最终一一解决设计中遇到的问题。还有在实验设计中我们曾遇到多块芯片以及数码管损坏的情况造成了数字钟的显示没有达到预期的效果，或是根本不显示，通过错误排除最终确认是元件问题，并向老师咨询跟换元件最终的到解决。在我们曾经遇到不懂的问题时，利用网上的资源，搜索查找得到需要的信息。

62

E. 电子钟课程设计:

目录
1 设计目的 3
2 设计要求指标 3
2.1 基本功能 3
2.2 扩展功能 4
3．方案论证与比较 4
4 总体框图设计 4
5 电路原理分析 4
5.1数字钟的构成 4
5.1.1 分频器电路 5
5.1.2 时间计数器电路 5
5.1.3分频器电路 6
5.1.4振荡器电路 6
5.1.5数字时钟的计数显示电路 6
5.2 校时电路 7
5.3 整点报时电路 8
6系统仿真与调试 8
7.结论 8
参考文献 9
实验作品附图 10

数字钟

摘要：
数字钟是一种用数字电路技术实现时、分、秒计时的装置，与机械式时钟相比具有更高的准确性和直观性，且无机械装置，具有更更长的使用寿命，因此得到了广泛的使用。
数字钟从原理上讲是一种典型的数字电路，其中包括了组合逻辑电路和时序电路。目前，数字钟的功能越来越强，并且有多种专门的大规模集成电路可供选择。
从有利于学习的角度考虑，这里主要介绍以中小规模集成电路设计数字钟的方法。
经过了数字电路设计这门课程的系统学习，特别经过了关于组合逻辑电路与时序逻辑电路部分的学习，我们已经具备了设计小规模集成电路的能力，借由本次设计的机会，充分将所学的知识运用到实际中去。
本次课程设计要求设计一个数字钟，基本要求为数字钟的时间周期为24小时，数字钟显示时、分、秒，数字钟的时间基准一秒对应现实生活中的时钟的一秒。供扩展的方面涉及到定时自动报警、按时自动打铃、定时广播、定时启闭路灯等。因此，研究数字钟及扩大其应用，有着非常现实的意义。
1 设计目的
1．掌握数字钟的设计、组装与调试方法。
2．熟悉集成元器件的选择和集成电路芯片的逻辑功能及使用方法。
3．掌握面包板结构及其接线方法
4．熟悉仿真软件的使用。
2 设计要求及指标
2．1基本功能
1）时钟显示功能，能够正确显示“时”、“分”、“秒”。
2）具有快速校准时、分、秒的功能。
3）用555定时器与RC组成的多谐振荡器产生一个标准频率（1Hz）的方波脉冲信号。
2．2扩展功能
1）用晶体振荡器产生一个标准频率（1Hz）的脉冲信号。
2）具有整点报时的功能。
3）具有闹钟的功能。
4）……

3、方案论证与比较
本设计方案使用555多谐振荡器来产生1HZ的信号。通过改变相应的电阻电容值可使频率微调，不必使用分频器来对高频信号进行分频使电路繁复。虽然此振荡器没有石英晶体稳定度和精确性高，由于设计方便，操作简单，成为了设计时的首选，但是由于与实验中使用的555芯片产生的脉冲相比较，利用晶振产生的脉冲信号更加的稳定，同过电压表的测量能很好的观察到这一点，同时在显示上能够更加接进预定的值，受外界环境的干扰较少，一定程度上优于使用555芯片产生信号方式。我们组依然同时设计了555和晶振两个信号产生电路。（本实验报告中着重按照原方案设计的555电路进行说明）
4、 系统设计框图
数字式计时器一般由振荡器、分频器、计数器、译码器、显示器等几部分组成。在本设计中555振荡器及其相应外部电路组成标准秒信号发生器，由不同进制的计数器、译码器和显示器组成计时系统。秒信号送入计数器进行计数，把累计的结果以‘时’、‘分’、‘秒’的数字显示出来。‘时’显示由二十四进制计数器、译码器、显示器构成，‘分’、‘秒’显示分别由六十进制计数器、译码器、显示器构成。其原理框图如图1.1所示。

5、电路原理分析

5.1数字钟的构成
数字钟实际上是一个对标准频率(1HZ)进行计数的计数电路.由于计数的起始时间不可能与标准时间一致,故需要在电路上加一个校时电路,同时标准的1HZ时间信号必须做到准确稳定.在此使用555振荡器组成1Hz的信号。

数字钟原理框图（1.1）

5．1.1振荡器电路
555定时器组成的振荡器电路给数字钟提供一个频率为1Hz的方波信号。其中OUT为输出。

5.1.2时间计数器电路
时间计数电路由秒个位和秒十位计数器,分个位和分十位计数器及时个位和时十位计数器电路构成,其中秒个位和秒十位计数器、分个位和分十位计数器为60进制计数器,而根据设计要求,时个位和时十位计数器为24进制计数器.

5.1.3分频器电路
通常，数字钟的晶体振荡器输出频率较高，为了得到1Hz的秒信号输入，需要对振荡器的输出信号进行分频。
通常实现分频器的电路是计数器电路，一般采用多级2进制计数器来实现。例如，将32768Hz的振荡信号分频为1HZ的分频倍数为32768（ ），即实现该分频功能的计数器相当于15级2进制计数器。

5.1.4振荡器电路
利用555定时器组成的多谐振荡器接通电源后，电容C1被充电，当电压上升到一定数值时里面集成的三极管导通，然后通过电阻和三极管放电，不断的充放电从而产生一定周期的脉冲，通过改变电路上器件的值可以微调脉冲周期。

5.1.5数字时钟的计数显示控制
在设计中，我们使用的是74**160十进制计数器，来实现计数的功能，实验中主要用到了160的置数清零功能（特点：消耗一个时钟脉冲），清零功能（特点：不耗时钟脉冲），在上级160控制下级160时候通过组合电路（主要利用与非门）实现，在连接电路的时候要注意并且强调使能端的连接，其将影响到整一个电路的是否工作。

电路的控制原理如下：
秒钟由个位向十位进位：0000—0001—0010—0011—0100—0101—0110—0111—1000—1001实现个位的计数，采用的是置数的方式（利用RCO端口），当电路计数到1001的时候采用一个二输入与非门接上级输入的高位和低位输出作为下级的信号，实现了秒区的个位和十位的显示与控制。设计中注意到接的是一个与非门而不是与门，目标在产生一个时钟脉冲。实现正确的显示。
由秒区向分区的显示控制：
基本原理同上，在秒区十位向时区个位显示的时：0000—0001—0010—0011—0100—0101产生了六个脉冲的时候向下级输出一个时钟脉冲，利用的还是与非门，目标仍是实现正确的计时显示。
分区的显示及整体电路反馈清零：
当数值显示达到：23：59的时候要实现清零的工作，采用CLR清零的方式反馈清零。具体设计接出控制端的9，5，3，2用十六进制表示后高电平对应引脚接与非，将非门输出信号的值反馈给各个160芯片的清零端（CLR）既可以实现清零了。

5.2 校时功能的实现
当重新接通电源或走时出现误差时都需要对时间进行校正.通常,校正时间的方法是:首先截断正常的计数通路,然后再进行人工出触发计数或将频率较高的方波信号加到需要校正的计数单元的输入端,校正好后,再转入正常计时状态即可.
根据要求,数字钟应具有分校正功能,因此,应截断分个位的直接计数通路,并采用正常计时信号与校正信号可以随时切换的电路接入其中.
在实验实现过程中使用的是通过开关（普通开关）来实现高低电平的切换，手动赋予需要的高低电平来实现脉冲的供给，将脉冲提供到所需要的输入（CLK）端口，实现校时，仿真过程中能够正常校时并且在校时的时候达到了预定的效果；而在我们进入实际电路连接的时候，利用开关（手控导线点触实现）来实现校时再不像仿真那样的精确了，原因分析是由于使用的是普通的开关同时利用的是手动的对CLK端口赋予脉冲信号，在实现手动生成脉冲信号的过程中产生了扰动，即相当于产生了多个的脉冲信号对需要的数码管进行校时，如此，并没有达到仿真的精确效果，但是在实验中通过改进电路的校时方式，不是用手触开关产生脉冲信号（如若需用手触则需要使用一个锁存器实现去抖动，才能够在脉冲生成时候不产生干扰的脉冲，实现正常的校时），而是使用信号发生器实现信号的提供，对需要校时的数码管在相对应的CLK端口提供脉冲信号实现校时，利用此方式实现校时则比手触开关方式效果要好。

5.3 报时的实现
报时功能的实现原理较为简单，即对所需要报时的输出量进行控制，并对控制产生的信号作为LED显示的信号源，电路连接中要注意到的是在实现LED显示的时候最好连接上一个保护电阻对LED灯器到保护的作用。例如我们的校时时间是 23：59，0010—0011—0101—1001；利用相应的门电路实现满足端口输出是上述条件的时候进行报时即可。

6、系统仿真与调试

7、结论
学贵以致用，通过几天的数字钟设计过程，将从书本上学到的知识应用于实践，学会了初步的电子电路仿真设计,虽然过程中遇到了一些困难，但是在解决这些问题的过程无疑也是对自己自身专业素质的一种提高。当最终调试成功的时候也是对自己的一种肯定。在当前金融危机大的社会背景下，能够增加自身砝码的不仅仅是一纸文凭证书，更为重要的是毕业生是否能够适应社会大潮流的需要，契合企业的要求即又较硬的动手操作及设计能力。此次的设计作业不仅增强了自己在专业设计方面的信心，鼓舞了自己，更是一次兴趣的培养，为自己以后的学习方向的明确了重点。
另外在这次实验中我们遇到了不少的问题针对不同的问题我们采取不同的解决方法，最终一一解决设计中遇到的问题。还有在实验设计中我们曾遇到多块芯片以及数码管损坏的情况造成了数字钟的显示没有达到预期的效果，或是根本不显示，通过错误排除最终确认是元件问题，并向老师咨询跟换元件最终的到解决。在我们曾经遇到不懂的问题时，利用网上的资源，搜索查找得到需要的信息。

F. 急求上课打铃自动报时电路,不能使用单片机

这难度很大啊，首先怎么定时计时就是问题，如果不使用单片机而使用数字逻辑芯片，那规模可不小！并且还要设置一系列的打铃时间……恐怖啊！

G. 基于8051单片机的自动打铃系统系统的 proteus仿真

H. 自动打铃器设计---数电课程设计（高分悬赏！！！）

呃、没有啊、我也要呢

I. 跪求数字电路课程设计《自动打铃器》

楼主你有点天真，这样的问题没有上百分不可能有人给你做，除非人家以前做过，有现成的还差不多！
课程设计还是自己动手风衣足食吧。